News Intel mit komplett neuer CPU-Architektur nach 2019?

[Nero24]

Die in den kommenden Tagen offiziell erwarteten neuen Intel-Prozessoren auf Basis der “Kaby Lake”-Kerne sind bereits die siebte Evolutionsstufe der Core-i-Technologie, die Ende 2008 mit Nehalem und der ersten Implementierung “Bloomfield” seinen Anfang nahm. Seither gab es diverse Weiterentwicklungen, entweder an der Architektur oder an der Fertigung. Nun gibt es allerdings Gerüchte, dass Intel für die Zeit nach Tigerlake an einer völlig neuen Mikroarchitektur arbeite.
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[MacroWelle]

Vielleicht schmeißen sie dann auch 32 Bit über Bord oder emulieren es.

 

[sharptooth]

Also dass der P4 ein bescheidener Erfolg war, stimmt meiner Meinung nach nur aus technischer Sicht. Aus ökonomischer Sicht kann man nicht gerade behaupten, dass Intel zu der Zeit am Hungertuch genagt hat ... Der P4 verkaufte sich wie blöde, Intel hat sich daran dumm und dusselig verdient. Viele Käufer sind auf den bekannten "Gigahertz-Wahn" reingefallen. Teilweise auch auf gefälschte Benchmarks, wie Intel unlängst zugegeben hat

Klar, wo der Athlon 64 raus kam, sah Intel kein Land mehr gegen AMD. Das und die ungeplant hohen Leckströme bei höheren Taktfrequenzen führten letztendlich zum Einmotten der Netburst-Architektur.

Sharpy

 

[Flodul]

Was die mal machen könnten, wäre ein breiters SMT, also vier oder acht Threads pro Kern. Das würde auf jeden Fall bei Anwendungen helfen bei denen Instukrionen mit längerer Laufzeit stallen. Workloads mit großen Working-Sets wo Load-Instruktionen die Pipe stallen weil man auf Speicherhierarchie-Ebenen jenseits des L1-Caches warten muss könnten auf jeden Fall davon profitieren. Der Xeon Phi Knights Landing hat ja z.B. vierfach SMT, was sicher auf solche Anwendungen abzielt.
Dass Intel auf dem Markt von Mobilgeräten noch eine Chance hat glaub ich allerdings nicht. Da ist Intel sowohl mit XScale als auch mit den Mobil-Atoms gescheitert und das würde sicher mit einer neuen CPU fortgesetzt.

 

[sompe]

Vielleicht schmeißen sie dann auch 32 Bit über Bord oder emulieren es.

Ham se doch schon beim Itanium versucht.

 

[cyrusNGC_224]

Vielleicht schmeißen sie dann auch 32 Bit über Bord oder emulieren es.

Ich glaube, das geht nicht.

Aber ich weiß nicht ob das absägen von MMX oder SSE vllt. so viel Ersparnis bringt? Wird das heute nicht auch in den Registern der moderneren Befehlssätze mit erledigt?

Der P4 verkaufte sich wie blöde, Intel hat sich daran dumm und dusselig verdient.

Oh ja, weswegen sie eigentlich nie so wirklich in Not waren, wie es AMD lange Zeit permanent war/ist.

Was die mal machen könnten, wäre ein breiters SMT, also vier oder acht Threads pro Kern.

Das würde für eine speziellere CPU Arch für den HPC Markt zutreffen, aber doch nicht für eine mit noch breiterem Anwendungsfeld. IBM kann sich das mit Power für die kleine Nische leisten und voll drauf ausrichten.

 

[Flodul]

Das würde für eine speziellere CPU Arch für den HPC Markt zutreffen, aber doch nicht für eine mit noch breiterem Anwendungsfeld. IBM kann sich das mit Power für die kleine Nische leisten und voll drauf ausrichten.

Nicht nur HPC, auch Server-Anwendungen würden davon profitieren. Oder Anwendungen wie Video-Encoding (x264/5 z.B.).
Und das zusätzliche SMT kostet nur wenig Chipfläche. Und IBM zeigt, dass das auch bei bis zu 5GHz geht.

 

[WindHund]

Nicht nur HPC, auch Server-Anwendungen würden davon profitieren. Oder Anwendungen wie Video-Encoding (x264/5 z.B.).
Und das zusätzliche SMT kostet nur wenig Chipfläche. Und IBM zeigt, dass das auch bei 4+GHz geht.

Weihnachten ist rum, viel ist von der Gans nicht mehr übrig, paar bones.

 

[ONH]

vieleicht streichen sie den ganzen legacy Features, wie es Sony bei der PS4 gemacht hat laut letzter Hacker-Präsentation.

https://fail0verflow.com/media/33c3-slides