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Ich denke, dass Zen4 schon ein paar Dinge hat, die darueber hinaus gehen - oder!?Zen4 bringt doch schon VNNI und AVX512.
Ich denke, dass bei Zen5 das Thema weiter verfeinert ist oder schlicht ausgebaut wird.
Nicht zuletzt muss man heute ueberall AI draufmalen sonst hat man den Zug verpasst.
Oft steckt dahinter erstaunlich wenig AI im Detail.
TNT
sompe
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Geht es bei dem AI Thema nicht selten um eine Verringerung der Rechenpräzision um darüber die Rechenleistung zu steigern? Ich gehe davon aus das es dafür noch ein paar Anpassungen bei den Befehlssätzen geben wird.
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Zen 5 wirft schon mal ein paar neue Codenamen in die Runde.
Breithorn und Zermatt (hier nicht aufgeführt) sind wohl schon seit Mitte letzten Jahres im Gespräch.
Weisshorn ist aber anscheinend neu.
MrBad
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Breithorn gefällt mir und passt doch zu uns.
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Ich glaube nicht an 2023.
1 Halbjahr 2024 wäre schon gut.
Edit:
Wobei es möglich wäre. Milan wurde ja wegen CXL 2 Quartale nach hinten verschoben.
Wenn man von der üblichen Kadenz von 14 bis 16 Monaten ausgeht und die Gerüchte stimmen, dass AMD auf N4 gehen will.
Silicon soll auch bereits gebootet haben, da wäre eigentlich 9 Monate später drin.
1 Halbjahr 2024 wäre schon gut.
Edit:
Wobei es möglich wäre. Milan wurde ja wegen CXL 2 Quartale nach hinten verschoben.
Wenn man von der üblichen Kadenz von 14 bis 16 Monaten ausgeht und die Gerüchte stimmen, dass AMD auf N4 gehen will.
Silicon soll auch bereits gebootet haben, da wäre eigentlich 9 Monate später drin.
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Ich schmeiß mal die fragliche Folie rein:
Es ergeben sich für Zen 5 zu Zen 4 genau 30% Steigerung der Performance, IPC darunter, weil Zen 5 höher taktet.
Woher Keller (nun CEO von tenstorrent) die Zahlen hat. Who knows.
Interessant aber auch, das Nvidias Grace dort auftaucht.
Complicated
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Ich finde diese Folie sehr irreführend.
Da werden schon Prognosen für Desktop-Modelle abgegeben, die darauf basieren. Wenn Keller für Zen5 im Server HBM annimmt, kann man ebenfalls diese Steigerung bei Singlethread erreichen. Siehe Sapphire Rapids in der Folie. Davon ist in Intel Desktop-Modellen wenig zu sehen. HBM würde bei Zen5 Desktop ebenfalls nicht vorhanden sein. Das gilt auch für viele andere Teile der unterschiedlichen Systemintegration der CPU-Cores für Server, Mobile oder Desktop.
Ich würde hier gerne mal CPU Singlethread einer MI300 mit dargestellt sehen um den HBM Effekt zu sehen mit Zen4.
Da werden schon Prognosen für Desktop-Modelle abgegeben, die darauf basieren. Wenn Keller für Zen5 im Server HBM annimmt, kann man ebenfalls diese Steigerung bei Singlethread erreichen. Siehe Sapphire Rapids in der Folie. Davon ist in Intel Desktop-Modellen wenig zu sehen. HBM würde bei Zen5 Desktop ebenfalls nicht vorhanden sein. Das gilt auch für viele andere Teile der unterschiedlichen Systemintegration der CPU-Cores für Server, Mobile oder Desktop.
Ich würde hier gerne mal CPU Singlethread einer MI300 mit dargestellt sehen um den HBM Effekt zu sehen mit Zen4.
enigmation
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Jim Keller, der wo an allen Architekturen mit gearbeitet hat ?
Ich schmeiß mal die fragliche Folie rein:
Es ergeben sich für Zen 5 zu Zen 4 genau 30% Steigerung der Performance, IPC darunter, weil Zen 5 höher taktet.
Woher Keller (nun CEO von tenstorrent) die Zahlen hat. Who knows.
Interessant aber auch, das Nvidias Grace dort auftaucht.
Der kann doch durch eine CPU fliegen und sieht wo welches Elektron hinfliegt: Projection
Der hat bestimmt auch ein Simulator gebastelt via AI.
sompe
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Ein weiteres Geruecht:
Early Dual AMD Zen5 CPU system scores 123K points in Cinebench - VideoCardz.com
AMD Zen5 allegedly tested with Cinebench R23 AMD Zen5 architecture debut is not expected anytime soon, but early engineering samples are apparently already running in the labs. Moore’s Law is Dead claims to have a screenshot featuring a Zen5 pre-release hardware running a popular benchmark. The...
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Youtuber RedGamingTech bestätigt noch einmal satte 20 - 30 % IPC-Gewinn, die 5 % weniger Takt werden einem dicken Plus nicht im Wege stehen.
Erneut wird von der 4 nm-Fertigung gesprochen, während "dicke" Server (nicht ZEN 5c) auf 3 nm gehen sollen. Das hieße erstmals getrennte Dies in den beiden Segmenten.
Da kann ComputerBase Meteor Lake, der gar nicht in den Desktop kommt, noch so oft als "Gamechanger" hochjubeln (ja, genau, neulich erst ).
Bei "nicht in den Desktop" muss man auch nicht groß rumschwurbeln und auf obskure All-in-One-Geräte zeigen (weil diese Notebook-CPUs haben).
Erneut wird von der 4 nm-Fertigung gesprochen, während "dicke" Server (nicht ZEN 5c) auf 3 nm gehen sollen. Das hieße erstmals getrennte Dies in den beiden Segmenten.
AMD Zen 5: Weniger Takt und dafür mehr IPC? [Gerücht]
AMD soll laut Gerüchten den Takt bei Zen 5 leicht reduzieren, dafür aber viel IPC gefunden haben, was der Single-Thread-Performance zugutekommt.
www.pcgameshardware.de
Da kann ComputerBase Meteor Lake, der gar nicht in den Desktop kommt, noch so oft als "Gamechanger" hochjubeln (ja, genau, neulich erst ).
Bei "nicht in den Desktop" muss man auch nicht groß rumschwurbeln und auf obskure All-in-One-Geräte zeigen (weil diese Notebook-CPUs haben).
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Leaks zu AMD Zen 5/6: IPC, Kerne, Release und mehr [Gerücht]
Über den bekannten Youtuber Moore's Law Is Dead kommen Leaks zu Zen 5 und Zen 6 von AMD.
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Hmm, eigentlich war öfter über die höhere IPC-Angabe berichtet worden. Hier sollen es doch wieder 10-15 % sein, also abwarten.
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IPC ist eben auch stark Software abhängig. Zen 5 bietet laut den leaks wohl 50% mehr integer ALUs und AGUs sowie ein entsprechend breiteres Frontend. Das FP Backend bleibt wohl so breit wie gehabt, aber optional mit 512 Bit Ausführungseinheiten. Damit wird also AVX/AVX2 Code wohl kaum schneller laufen, AVX512 unter Umständen aber deutlich.
Im integer Bereich hängt es dann auch stark davon ab, ob der Code Cache/Latenz limitiert ist oder nicht, damit der breitere Core seine Leistung entfalten kann. Zwischen 10-30% halte ich da alles für möglich.
Spiele dürften wohl am Meisten von höheren Cache Hitrates profitieren. Da gibt es immerhin einen leicht größeren L1D, viel wird hier aber auch wieder vom L3 und vielleicht dem größeren 16 Core CCX abhängen.
Im integer Bereich hängt es dann auch stark davon ab, ob der Code Cache/Latenz limitiert ist oder nicht, damit der breitere Core seine Leistung entfalten kann. Zwischen 10-30% halte ich da alles für möglich.
Spiele dürften wohl am Meisten von höheren Cache Hitrates profitieren. Da gibt es immerhin einen leicht größeren L1D, viel wird hier aber auch wieder vom L3 und vielleicht dem größeren 16 Core CCX abhängen.
Complicated
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AMD hat AVX Workloads bisher nie bei IPC mit verwendet. Ich finde gerade die Quelle nicht, wo ich das gelesen habe. Das breitere Design soll ja gerade bei AVX512 Performance bringen, bei niedrigem Stromverbrauch. Es könnte sein, das die IPC-Kennzahl hier irreführende ist. Eigentlich ein guter strategischer Zug, jetzt AVX zu puschen um Intel AMX zu verlangsamen (Entwickler bleiben bei AVX) und die Optimierung der Vektor-Workloads zwischen iGPU, AI und CPU voran zu treiben.
Dafür wird Cinebench gerne von Testern als IPC Bench verwendet. Und das benutzt zwar AVX, aber meines Wissens nach immer noch kein AVX-512.
Und Intel drückt sich um die unrühmliche Vergangenheit von AVX-512 indem sie es jetzt in AVX10 umbenennen wollen. Je nachdem ob der Code damit abwärtskompatibel bleibt könnte künftig eine Marktdurchdringung von AVX-512 schwierig werden und damit als AMD Bremse dienen. Aber vielleicht überrascht AMD ja auch mit einer schnellen AVX10 Integration in Zen5.
Das könnte sogar gut dazu passen, dass in den Leaks von ZEN5 Varianten mit und ohne 512 Bit support zu lesen war.
Viel interessanter empfinde ich bei Zen5 nichts desto trotz den deutlich überarbeiteten Integer Bereich bis hin zum Frontend.
Und Intel drückt sich um die unrühmliche Vergangenheit von AVX-512 indem sie es jetzt in AVX10 umbenennen wollen. Je nachdem ob der Code damit abwärtskompatibel bleibt könnte künftig eine Marktdurchdringung von AVX-512 schwierig werden und damit als AMD Bremse dienen. Aber vielleicht überrascht AMD ja auch mit einer schnellen AVX10 Integration in Zen5.
Das könnte sogar gut dazu passen, dass in den Leaks von ZEN5 Varianten mit und ohne 512 Bit support zu lesen war.
Viel interessanter empfinde ich bei Zen5 nichts desto trotz den deutlich überarbeiteten Integer Bereich bis hin zum Frontend.
Auf chipsandcheese sind kürzlich 2 interessante Artikel erschienen.
Zen 5’s Leaked Slides und
AVX10/128 is a silly idea and should be completely removed from the specification.
Zen 5’s Leaked Slides und
AVX10/128 is a silly idea and should be completely removed from the specification.
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